Muse Spark Open解码破千tokens/s:megakernel怎么做到的

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本文详解SGLang为何转向megakernel架构,并介绍为Muse Spark Open从零用CUDA C++与PTX构建的megakernel实现。该方案将Blackwell GPU上的单请求解码速度从517 tok/s提升至1109 tok/s,性能提升2.1倍。通过单层单核、12个warp分工、权重全缓存预取

所属频道 算力与芯片

SGLang和ML基础设施正在往更大规模的GPU核,也就是megakernel方向走。有人从零开始,用CUDA C++和PTX给Muse Spark Open写了一个megakernel,把Blackwell GPU的单请求解码速度从517 tok/s拉到1109 tok/s。

Decode tokens per second, one request at a time: baseline 517, megakernel 1,109, 2.1 times as fast

Muse Spark Open用的是传统MoE结构:每个token路由到256个专家中的8个,专家权重以4位NVFP4格式存放,一共62个解码层。

什么是megakernel?

普通的GPU核只干一件事,服务引擎跑完一次解码步要发射大约1450个核。优化不到位的话,核与核之间GPU就会闲着。megakernel的做法是让一个核常驻所有SM,多种任务同时在里面跑,张量核、TMA、NVLink这些引擎一直保持全速。

CPUs went from batch jobs to multiprogramming to operating systems; GPUs went from one kernel per operation to megakernels

模型与新张量并行

模型按TP8切分,跑在8张GPU上。传统TP在两个MoE GEMM之间只做一次all-reduce;新方案则在N维上把这两个GEMM切开,加了fp4 all-gather和bf16 all-gather。通信多了一步,但总通信量反而更低,扩展性也更好。

One decoder layer in six steps, with five numbered stops where it waits for the other GPUs; the expert steps are marked as known only after the router runsThe expert GEMMs across eight GPUs: vanilla TP splits GEMM 1 on N and GEMM 2 on K and ends with one bf16 all-reduce; ours splits both on N, with an fp4 all-gather after GEMM 1 and a bf16 all-gather after GEMM 2

megakernel实现

每层只发射一次核,覆盖范围从本层attention一直到下一层的qkv投影和KV写入。每个核在144个SM上放12个warp,KV加载、权重预取、张量核计算、SwiGLU以及all-gather/reduce分别由不同warp负责。

Four slots of a receive buffer: all empty before any store; two values landed and the reader keeps polling; all four landed and the reader goes

性能与投机解码

单步解码耗时从12.9 ms降到5.9 ms,核数量从1450减到97。再配上DFlash V2 draft模型,每步验证16 token,平均接受6.6 token,速度达到1109 tok/s。

One decode step: baseline takes 12.9 ms (draft 1.16, verify 10.9) with 1,450 kernels; Megakernel takes 5.9 ms (draft 0.44, verify 5.3) with 97 kernels

megakernel内部优化

具体做法包括权重全缓存预取、指令缓存管理、多级同步(shared memory mbarrier、HBM flag、NVLink直接store),以及不带fence的数据同步,几项合起来让重叠几乎做到完美。

Three places a prefetched weight can wait: straight into the shared-memory ring while the current op runs; into L2 for what does not fit, like the speculatively prefetched experts; or both, with the ring refilling from L2 instead of HBMTwo blocks of code run back to back: 20 KB + 100 KB fit in an SM's instruction cache of about 128 KB, and the 100 KB block runs at its solo 12.4 µs; 100 KB + 100 KB do not fit, and every pass takes 19.5 µsWhere threads meet to synchronize: two warps in the same SM wait on an mbarrier in shared memory; warps on two SMs of one GPU meet at a flag in HBM, polled; a warp on another GPU stores over NVLink straight into this GPU's HBM, where the reader polls for the dataFence-free data synchronization: with a weight stream in flight, the fence before the flag takes 3.6-4.0 µs; when the data is its own flag, the reader starts as soon as the data lands

展望

后续计划支持更大的批次,并朝GPU操作系统的方向演进。

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